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【FPGA项目】沙盘演练——基础版报文收发(二)
2023-09-23 15:43:29 【大 中 小】 浏览:180次
Tags：FPGA 项目 沙盘演 文收发
目，完成了testbench的编写，仿真验证，是对自己设计的一次检验，是实际项目缩短调试时间的最佳利器。
  • 对xilinx IP的使用，对datasheet的阅读学习。
  • 对时序的理解，时钟是FPGA的心跳：任何时序操作都是发生在时钟的跳变沿。当采样发生在当前上升沿时刻，数据变化是发生在下一时刻的上升沿。
  • 绘画时序图，TimingDesigner的使用。有了时序图，代码就很容易实现了。

    •  

    5. 进阶考虑

    本次虚拟项目旨在用最简单的例子带大家了解数字逻辑设计的一些基本概念，所以很多东西是没有考虑的。比如：

    1. 如果包间隔小于2个时钟周期怎么办？ -----握手与反压
    2. 如果输入数据有错误怎么办？ -----CRC校验
    3. 如果需要跨时钟域传输呢？ -----CDC处理
    4. 报文只是简单转发，如果需要做处理呢？-----数据处理
    5. ...

     

    所以，下一篇将沿着这个思路展开，进阶版的虚拟项目，同样可以作为公司的入职培训。

    咱们下期见！

     

     

     

     
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